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Was ist formale Verifikation? Laut wikipedia.org. "Im Kontext von Hardware- und Softwaresystemen ist formale Verifikation der Akt, die Korrektheit der beabsichtigten Algorithmen, die einem System zugrunde liegen, in Bezug auf eine bestimmte formale Spezifikation oder Eigenschaft zu beweisen oder zu widerlegen, unter Verwendung formaler Methoden der Mathematik. Formale Verifikation kann hilfreich sein, um die Korrektheit von Systemen wie kryptografischen Protokollen, kombinatorischen Schaltungen, digitalen Schaltungen mit internem Speicher und Software, die als Quellcode ausgedrückt ist, zu beweisen. Die Verifikation dieser Systeme erfolgt durch Bereitstellung eines formalen Beweises eines abstrakten mathematischen Modells des Systems, wobei die Übereinstimmung zwischen dem mathematischen Modell und der Natur des Systems, das ansonsten durch Konstruktion bekannt ist, bekannt ist. Beispiele für mathematische Objekte, die häufig zur Modellierung von Systemen verwendet werden, sind endliche Automaten, beschriftete Übergangssysteme, Petrinetze, Vektoraddition Systeme, zeitliche Automaten, hybride Automaten, Prozessalgebra und formale Semantik von Programmiersprachen wie operationale Semantik, denotationale Semantik, axiomatische Semantik und Hoare-Logik.
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#pact #formal #verification
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0:15 Was ist formale Verifikation
1:15 Stuart Popejoy Kadena CEO Rede
3:30 Wie funktioniert formale Verifikation?
8:37 Wie funktioniert Pact?
9:30 Kadena und Pact wurden in Haskell entwickelt!
11:34 Pact nutzt Microsofts Z3-Technologie
15:30 Ryan Matta Kadena Pact Review Outro
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